Vivado IP リリース ノート
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作成者: AMD
LogiCORE™ JTAG to AXI Master IP コアは、AXI トランザクションを生成して、FPGA 内部で AXI 信号を駆動するカスタマイズ可能なコアです。
LogiCORE™ JTAG to AXI Master IP コアは、AXI トランザクションを生成して、FPGA 内部で AXI 信号を駆動するカスタマイズ可能なコアです。AXI4 インターフェイスおよび Lite プロトコルをサポートし、パラメーターで選択できます。AXI のデータ バス幅はカスタマイズ可能です。この IP は、AXI4 インターコネクトを介して、AXI4-Lite または AXI4 メモリ マップ方式のスレーブを駆動できます。マスターとしてインターコネクトへ接続することも可能です。このコアを使用する場合、実行時の相互作用には、Vivado™ の Logic Analyzer 機能を使用する必要があります。
一部の AMD テクノロジでは、サードパーティによる有効化またはアクティブ化が必要になる場合があります。サポートされる機能はオペレーティング システムによって異なる場合があります。 具体的な機能については、システム メーカーにお問い合わせください。完全に安全なテクノロジや製品はありません。