Presentación de la FPGA AMD Virtex™ UltraScale+™ VU57P

Ancho de banda de memoria 20 veces superior y un 75 % menos de consumo energético
  • Mayor ancho de banda de memoria por vatio
  • Controlador HBM integrado y conmutador de puerto AXI para acceso de memoria contiguo a toda la HBM de 16 G
Movimiento de datos dos veces más rápido y los últimos estándares ópticos
  • Doble velocidad de transmisión con transceptores PAM4 de 58 G
  • Compatible con los últimos estándares ópticos:
    QSFP-DD y OSFP
Diseño simplificado para agilizar el tiempo de comercialización
  • Diseño más rápido y cierre de temporización
  • Conectividad integrada de alta velocidad:
    Ethernet de 100 G con RS-FEC, Interlaken de 150 G y PCIe® Gen4

Aplicaciones

Muchas de las aplicaciones actuales exigen más ancho de banda y capacidad de memoria de lo que pueden ofrecer las memorias básicas independientes, como DDR4. Las FPGA AMD Virtex™ UltraScale+™ VU57P permiten a los usuarios integrar capacidades de procesamiento de bajo consumo energético con el mayor ancho de banda y capacidad de memoria, mientras aprovechan los transceptores PAM4 de 58 G para duplicar la velocidad de transmisión de datos. Las FPGA Virtex UltraScale+ VU57P son ideales para cargas de trabajo sensibles a la latencia que necesitan procesar grandes conjuntos de datos con alto rendimiento.

Abstract connected dots and lines

Aceleración de procesamiento

Los datos de procesamiento previo son fundamentales para obtener los mejores resultados de los dispositivos de procesamiento de función fija. Con la lógica adaptable y el ancho de banda de 460 Gb/s de HBM, la FPGA Virtex UltraScale+ VU57P puede seleccionar, transformar y preparar datos a fin de optimizar las entradas para el acelerador objetivo. La FPGA Virtex UltraScale+ VU57P, equipada con transceptores PAM4 de 58 G de alta velocidad, maximiza el rendimiento general y del sistema.

Firewall de próxima generación

Los operadores de red buscan una disponibilidad de red sólida e ininterrumpida, y una administración inteligente, al tiempo que puedan proteger los datos y evitar los ataques de malware en las redes empresariales. La FPGA Virtex UltraScale+ VU57P facilita una escalabilidad inigualable para implementar seguridad de red de varias capas desde VPN hasta el nivel TLS con decenas de millones de sesiones simultáneas con políticas y controles personalizados, al tiempo que se mantiene el rendimiento de velocidad de línea y la baja latencia. Con una HBM de 16 G, los dispositivos de seguridad de última generación pueden administrar varias tablas de búsqueda mientras almacenan en búfer y reordenan los flujos de red. Los transceptores PAM4 de 58 G ofrecen compatibilidad con los últimos estándares ópticos para escalar hasta alcanzar el rendimiento superior que requieren los firewalls de última generación.

AMD Embedded Solutions for Networking
High tech technology connection system

Switches y enrutadores con QoS

La FPGA Virtex UltraScale+ VU57P con HBM de 16 G facilita un conmutador Nx400G/200G/100G/50G con canalización de datos de 400 G y un administrador de tráfico para QoS (Quality of Service, calidad de servicio). Los transceptores PAM4 de 58 G permiten la conectividad según los últimos estándares ópticos y duplican la velocidad de transmisión hacia y desde la función de conmutación primaria. La clasificación de paquetes, las tablas de búsqueda de conmutadores y rutas, y las colas del administrador de tráfico para el conmutador se implementan en la HBM. Teniendo en cuenta las restricciones de energía y temperatura, los conmutadores y enrutadores basados en FPGA Virtex UltraScale+ VU57P pueden implementar un mecanismo de refrigeración menos complejo con un mayor rendimiento a través de opciones de paquetes sin cubierta, fundamental para el centro de datos y la infraestructura de telecomunicaciones.

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Virtex UltraScale+ HBM FPGA VCU128 Evaluation Kit

Kit de evaluación VCU128 para FPGA Virtex UltraScale+ con HBM

La placa VCU128 incorpora la nueva FPGA AMD Virtex UltraScale+ VU37P con HBM que utiliza interconexión de chips apilados para agregar el chip de HBM junto al chip de FPGA en el sustrato del paquete.

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