Resumo do produto FPGA Virtex UltraScale+ HBM
Permita que os usuários integrem recursos de computação com eficiência de energia com a mais alta capacidade de memória e largura de banda/watt em um único dispositivo.
Apresentando a FPGA VU57P AMD Virtex™ UltraScale+™
Largura de banda de memória 20x maior com consumo de energia 75% menor
- Maior largura de banda de memória por watt
- Controlador HBM integrado e comutador de porta AXI para acesso de memória contígua a toda a HBM de 16 GB
Movimentação de dados 2X mais rápida e padrões ópticos mais recentes
- Transceptores 58G PAM4 com taxa de transmissão dupla
- Compatível com os mais recentes padrões ópticos:
QSFP-DD e OSFP
Projeto simplificado para agilizar o tempo de lançamento no mercado
- Projeto e encerramento de temporização mais rápidos
- Conectividade de alta velocidade integrada:
Ethernet 100G com RS-FEC, Interlaken 150G, PCIe® de 4ª geração
Aplicações
Muitos dos aplicativos atuais exigem mais largura de banda e capacidade de memória do que memórias de commodity dedicadas, como a DDR4, podem oferecer. As FPGAs VU57P AMD Virtex™ UltraScale+™ permitem que os usuários integrem recursos de computação com eficiência de energia com a mais alta largura de banda e capacidade de memória e, ao mesmo tempo, aproveitem transceptores 58G PAM4 para dobrar a taxa de transmissão de dados. As FPGAs VU57P Virtex UltraScale+ são ideais para cargas de trabalho sensíveis à latência que precisam processar grandes conjuntos de dados com alta produtividade.
Aceleração de computação
O pré-processamento de dados é essencial para obter os melhores resultados dos dispositivos de computação de função fixa. Com a lógica adaptável e 460 GB/s de largura de banda de HBM, a FPGA VU57P Virtex UltraScale+ pode selecionar, transformar e organizar dados para otimizar entradas para o acelerador de destino. Equipada com transceptores PAM4 de 58G de alta velocidade, a FPGA VU57P Virtex UltraScale+ maximiza a produtividade e o desempenho do sistema.
Firewall da nova geração
As operadoras de rede desejam disponibilidade de rede contínua e robusta, além de gestão inteligente, protegendo os dados e evitando ataques de malware em redes corporativas. A FPGA VU57P Virtex UltraScale+ possibilita escalabilidade inigualável para implementar segurança de rede multicamadas, de VPNs ao nível TLS, com dezenas de milhões de sessões simultâneas, com políticas e controles personalizados, mantendo, ao mesmo tempo, a taxa de transferência de dados/taxa de linha e a baixa latência. Com a HBM de 16G, os aparelhos de segurança de última geração podem gerenciar múltiplas tabelas de consulta (LUTs) enquanto armazenam em buffer e reordenam fluxos de rede. Os transceptores PAM4 de 58G são compatíveis com os mais recentes padrões ópticos, o que permite que sejam dimensionados para aumentar a produtividade exigida pelos firewalls de última geração.
Comutadores e roteadores com QoS
A FPGA VU57P Virtex UltraScale+ com HBM de 16G possibilita um comutador Nx400G/200G/100G/50G com um pipeline de datapath de 400G e gerenciador de tráfego para QoS. Os transceptores PAM4 de 58G permitem a conectividade com os padrões ópticos mais recentes e dobram a taxa de transmissão de/para a função de comutação primária. A classificação de pacotes, as tabelas de consulta (LUTs) de comutadores e rotas e as filas do gerenciador de tráfego para o comutador são implementadas na HBM. Tendo em mente as restrições de energia/temperatura, os comutadores e roteadores baseados em FPGA VU57P Virtex UltraScale+ podem implementar um mecanismo de resfriamento menos complexo com maior desempenho por meio de opções de pacotes sem custo, o que é essencial para o data center e a infraestrutura de telecomunicações.
Começar
Dê início ao seu ciclo de projeto e atinja um rápido tempo de lançamento no mercado com o hardware comprovado, o suporte de software, as ferramentas, os exemplos de projeto e a documentação disponíveis no kit.
Kit de avaliação da FPGA VCU128 Virtex UltraScale+ HBM
A placa VCU128 incorpora a nova FPGA AMD Virtex UltraScale+ VU37P HBM que utiliza interconexão de chip empilhado para adicionar o die da HBM próximo ao die da FPGA no substrato do pacote.
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