Cronograma de talleres próximos
- América
- Europa
- Asia
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Talleres de Vitis
| Taller/instructivo | Nivel | Placas |
Versiones |
|---|---|---|---|
| Introducción al motor de IA de SoC adaptable Versal™ y a su modelo de programación | Introducción | VCK5000 | 2022.2 |
| Aceleración del procesamiento con las herramientas de desarrollo de Vitis™ | Introducción | AWS-F1, Alveo | 2021.1 |
Talleres de Vivado
| Taller/instructivo | Nivel | Placas | Versiones |
|---|---|---|---|
| Flujo de diseño de FPGA (Field-Programmable Gate Array, matriz de puertas lógicas programable en campo) con Vivado™ | Introducción | ZedBoard, ZYBO, Nexys4/DDR, NexysVideo, Basys3, PYNQ-Z1, PYNQ-Z2 | 2021x, 2018x, 2016x, 2015x |
| Flujo de diseño de sistema integrado en Zynq™ | Introducción | ZedBoard, ZYBO, PYNQ-Z1, PYNQ-Z2 | 2021x, 2018x, 2015x, 2014x |
| Flujo de síntesis de alto nivel en Zynq | Introducción | ZedBoard, ZYBO, PYNQ-Z1, PYNQ-Z2 | 2021x, 2018x, 2017x, 2016x |
| Diseño avanzado de sistema integrado en Zynq | Intermedio | ZedBoard, ZYBO, PYNQ-Z1, PYNQ-Z2 | 2018x, 2017x, 2016x |
| Flujo de reconfiguración parcial en Zynq | Intermedio | ZedBoard, ZYBO | 2016x, 2015x, 2014x |
| Linux integrado en Zynq (Archivado) | Intermedio | ZedBoard, ZYBO | 2015x, 2014x, 2013x |
Material didáctico de Vivado
| Taller/instructivo | Nivel | Placas |
Versiones |
|---|---|---|---|
| Diseño de lenguaje de descripción de hardware | Introducción | Nexys4/DDR, Basys3 | 2015.1, 2013.3 |
| Diseño digital con IPI (Inter-Processor Interrupt, interrupciones entre procesadores) de Vivado | Introducción |
Nexys4/DDR, Basys3 | 2014.2 |