Notas de la versión Vivado IP
Este artículo contiene un listado de todos los registros de respuesta de “Notas de la versión de Vivado™ IP – Información del registro de cambios de todas las IP” y la versión correspondiente de las herramientas Vivado.
por: AMD
Esta IP es un periférico esclavo de 32 bits con una interfaz AXI4-Lite que proporciona la interfaz del controlador para el macro prediseñado y preverificado (hard macro) XADC en las familias Virtex™ 7, Kintex™ 7.
AXI XADC IP proporciona la interfaz del controlador para el macro prediseñado y preverificado (hard macro) XADC de System Monitor en las familias FPGA Virtex™ 7, Kintex™ 7, Artix™ 7 y Zynq™ 7000. Esta IP es un periférico esclavo de 32 bits con una interfaz AXI4-Lite que proporciona la interfaz de controlador para el macro prediseñado y preverificado (hard macro) XADC en las familias FPGA Virtex 7, Kintex 7, Artix 7 y Zynq 7000. Es compatible con el monitoreo en el chip de los voltajes de suministro y la temperatura. Esta IP admite un par dedicado de entrada analógica diferencial de alto ancho de banda y 16 pares auxiliares de entrada analógica diferencial de bajo ancho de banda.
| LogiCORE™ | Versión | Compatibilidad con AXI4 | Compatibilidad de software | Familias de dispositivos compatibles |
|---|---|---|---|---|
| AXI XADC | v2.0 | AXI4-Lite | Vivado™ 2013.1 | Zynq™ 000 Artix™ 7 Kintex™ 7 Virtex™ 7 |
| AXI XADC | v1.00a | AXI4-Lite | EDK™ 14.3 | Zynq 7000 Artix 7 Kintex 7 Virtex 7 |
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