Notes de publication Vivado IP
Cet article contient une liste de tous les registres de réponse « Notes de publication Vivado™ IP – All IP Change Log Information » et la version Vivado Tools associée.
par: AMD
L'AXI Register Slice peut être utilisé sur des chemins sélectionnés entre les points de terminaison, les communications transversales et les interconnexions AXI afin de rompre les chemins de synchronisation critiques et d'atteindre des fréquences d'horloge plus élevées.
L'AXI Register Slice peut être utilisé sur des chemins sélectionnés entre les points de terminaison, les communications transversales et les interconnexions AXI afin de rompre les chemins de synchronisation critiques et d'atteindre des fréquences d'horloge plus élevées. Pour chaque instance de Register Slice, vous pouvez activer de manière sélective le pipelining sur l'un des cinq canaux AXI. Les contraintes de placement rendent AXI Register Slice très utile pour franchir les limites SLR. Utilisez Register Slice directement dans votre conception ou entre des commutateurs, comme AXI Interconnect.
| LogiCORE™ | Version | Prise en charge d'AXI4 | Assistance software | Familles d'appareils prises en charge |
|---|---|---|---|---|
| AXI Register Slice | v2.1 | AXI4 AXI4-Lite AXI3 |
Vivado™ 2022.2 | Kintex™ UltraScale+™ Virtex™ UltraScale+ Zynq™ UltraScale+ Kintex UltraScale™ Virtex UltraScale Artix™ 7 Kintex 7 Virtex 7 Zynq 7000 Versal™ |
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