AMD Virtex™ UltraScale™ 完全符合数据中心的 25Gb 铜缆互连标准
这段视频展示了 AMD Virtex™ UltraScale™ 30 Gig GTY 收发器完全符合极具挑战且热门的数据中心以太网标准：100GBase-CR4 和 100GBase-KR4 电气标准。如视频所演示，AMD 收发器通过超高速率时钟性能和全自适应均衡实现了这一目标。
可编程系统集成
- 使用第二代 3D IC 时，以 20nm 制程工艺提供 550 万个系统逻辑单元
- 集成了 100G 以太网 MAC 和 150G Interlaken 的核
降低 BOM 成本
- 成本降低达 50%，是 Nx100G 系统每端口成本的一半
- 通过集成 VCXO 和小数分频 PLL 可降低时钟组件成本
- 中速等级芯片可支持 2400Mb/s DDR4
降低总功耗
- 功耗比上一代降低 40%
- 通过 UltraScale 器件的类似于 ASIC 的时钟实现精细时钟门控功能
- 增强型系统逻辑单元封装可减小动态功耗
提高设计生产力
- 与 Kintex™ UltraScale 器件封装兼容带来更高可扩展性
- 从 20nm 平面到 16nm FinFET 的无缝封装迁移
- 与 Vivado™ Design Suite 协同优化加快设计收敛
所有比较均基于 28nm Virtex 7 FPGA。
产品表
| XCVU065 | XCVU080 | XCVU095 | XCVU125 | XCVU160 | XCVU190 | XCVU440 | |
|---|---|---|---|---|---|---|---|
| 系统逻辑单元 (K) | 783 | 975 | 1,176 | 1,567 | 2,027 | 2,350 | 5,541 |
| DSP Slice | 600 | 672 | 768 | 1,200 | 1,560 | 1,800 | 2,880 |
| 内存 (Mb) |
44.3 | 50.0 | 60.8 | 88.6 | 115.2 | 132.9 | 88.6 |
| GTH 16.3Gb/s 收发器 | 20 | 32 | 32 | 40 | 52 | 60 | 48 |
| GTY 30.5Gb/s 收发器 | 20 | 32 | 32 | 40 | 52 | 60 | 0 |
| I/O 管脚数 | 520 | 832 | 832 | 802 |
702 |
702 |
1,456 |
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