Unübertroffene Performance und Leistung
Dieses Whitepaper enthält eine Analyse der Fähigkeiten des adaptiven Versal SoC auf Systemebene für eine Reihe von Märkten von der Edge und Cloud über kabelgebundene Vernetzung bis zur 5G/6G-Mobilfunkinfrastruktur.
Erfahren Sie, wie die Versal Architektur für weltweit führende Performance pro Watt im Vergleich zu konkurrierenden 10-nm-FPGA-Architekturen in Endanwendungen wie KI-Inferenz, Massive-MIMO, Netzwerkbeschleunigung, Speicher und Multi-Terabit-SmartPHY sorgt – unterstützt mit Daten, die mit öffentlichen Tools validiert werden können.
Adaptive AMD Versal SoCs ebenen den Weg für ein neues Paradigma des Systemdesigns und bauen zugleich auf bewährten FPGA-Designmethoden auf. Die Versal Architektur ist eine vollständig softwareprogrammierbare, heterogene Computing-Architektur mit einer Vielzahl von Hard-IPs.
Dieses Portfolio umfasst sowohl universelle adaptive SoCs als auch Geräte mit speziellen Funktionen wie KI-Engines für Auslastungen für DSP und maschinelles Lernen, integrierte RF-ADCs/RF-DACs, erweiterte DSP-Hard-IP-Funktionen oder High Bandwidth Memory.
Die integrierten Chipfunktionen in Verbindung mit einem optimierten Designablauf und den neuesten Erweiterungen der Vivado™ Tools ermöglichen sowohl Automatisierung als auch Benutzersteuerung, um bahnbrechende System-Performance pro Watt zu erzielen.
Mit 3-mal mehr Hard-IP als konkurrierende 10-nm-FPGAs bieten adaptive Versal SoCs eine gemeinsame Infrastruktur, wie z. B. das programmierbare NoC, über alle Geräte hinweg für eine einfache Programmierung und Codeübertragbarkeit sowie domänenspezifische Hard-IP für unterschiedliche Märkte.
Das ausgewogene Verhältnis aus programmierbarer Logik und Hard-IP bietet führende Performance pro Watt für fortschrittliche Anwendungen in den Bereichen Cloud, Netzwerk und Edge, während gleichzeitig die Hardwareflexibilität erhalten bleibt, damit Sie sich an sich verändernde Anforderungen und Dynamiken des Marktes anpassen können.
Überprüfung von AMD Versal Benchmarks im Vergleich zu konkurrierenden FPGAs gemäß Whitepaper WP539
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