Vivado IP リリース ノート
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作成者: AMD
UltraScale™ アーキテクチャ GTM トランシーバー用 Integrated Bit Error Ratio Test (IBERT) は、GTMトランシーバーの評価および監視に使用できます。
UltraScale™ アーキテクチャ GTMトランシーバー用 LogiCORE™ IP Integrated Bit Error Ratio Test (IBERT) は、GTMトランシーバーの評価および監視に使用できます。このコアには、GTM トランシーバーにインプリメントされるパターン ジェネレーターとパターン チェッカが含まれ、GTM トランシーバーのポートや DRP 属性へアクセスできます。さらに、通信ロジックが組み込まれているため、ランタイム中に JTAG 経由でデザインにアクセスできます。このコアは、ドキュメントに記載のとおり、内蔵型またはオープン デザインとして使用できます。
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