Vivado IP リリース ノート
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作成者: AMD
7 シリーズ FPGA GTZ トランシーバー用のカスタマイズ可能な LogiCORE™ IP ChipScope™ Pro Integrated Bit Error Ratio Test (IBERT) コアは、GTZ トランシーバーを評価および監視するために設計されています。
7 シリーズ FPGA GTZ トランシーバー用のカスタマイズ可能な LogiCORE™ IP ChipScope™ Pro Integrated Bit Error Ratio Test (IBERT) コアは、GTZ トランシーバーを評価および監視するために設計されています。このコアには、FPGA ロジックにインプリメントされるパターン ジェネレーターとパターン チェッカが含まれ、GTZ トランシーバーのポートや DRP 属性へアクセスできます。さらに、通信ロジックが組み込まれているため、ランタイム中に JTAG 経由でデザインにアクセスできます。このコアは、ドキュメントに記載のとおり、内蔵型またはオープン デザインとして使用できます。
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