Versionshinweise zu Vivado IP
Dieser Artikel enthält eine Liste aller Antwortdatensätze für „Vivado™ IP-Versionshinweise – Alle IP-Änderungsprotokollinformationen“ und der zugehörigen Version der Vivado-Tools.
von: AMD
Der AXI4 PCIe-Kern ermöglicht die Übersetzung von AXI4-Befehlen in PCIe®-TLP-Pakete und PCIe-Anfragen in AXI4-Befehle auf Transaktionsebene.
Der AXI PCIe® Gen 3-Subsystemkern dient als Schnittstelle zwischen der AXI4-Schnittstelle und dem Gen 3 PCI Express® (PCIe)-Silizium-Hardcore. Das AXI4 PCIe-Subsystem stellt vollständige Bridge-Funktionalität zwischen der AXI4-Architektur und dem PCIe-Netzwerk bereit. Das Subsystem besteht aus dem PCIe-Kern, der GT-Schnittstelle und der AXI4-Schnittstelle. Die Bridge-Schaltung ist im FPGA-Fabric implementiert und der PCIe-Kern und GT sind als Elemente im FPGA integriert.
Der AXI4 PCIe-Kern ermöglicht die Übersetzung von AXI4-Befehlen in PCIe-TLP-Pakete und PCIe-Anfragen in AXI4-Befehle auf Transaktionsebene.
| LogiCORE™ | Version | AXI4-Unterstützung | Software-Unterstützung | Unterstützte Chipfamilien |
|---|---|---|---|---|
| AXI Bridge for PCI Express® (PCIe®) Gen3-Subsystem |
v3.0 | AXI4 | Vivado™ 2024.1 | Kintex™ UltraScale™ Virtex™ UltraScale Virtex 7 XT |
| DMA/Bridge-Subsystem für PCIe im AXI-Bridge-Modus |
v3.0 | AXI4 | Vivado 2024.1 | Kintex 7 UltraScale+™ Virtex 7 UltraScale+ Zynq™ 7000 UltraScale+ |
Erforderliche Software von der AMD Downloads-Seite herunterladen. Informationen zu neuen Funktionen, bekannten Problemen und Patches finden Sie im Lizenzierungscenter.
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