ISE-Versionshinweise
Dieses Dokument enthält eine Tabelle mit Auflistungen der Versionshinweise für den jeweiligen IP-Kern.
von: AMD
Der ChipScope™ Pro Integrated Bit Error Ratio Tester (IBERT)-Kern für Virtex™ 5 FPGA GTX-Transceiver ist ein anpassbarer Kern, der zur Evaluierung und Überwachung des Zustands der GTX-Transceiver verwendet werden kann.
Der ChipScope™ Pro Integrated Bit Error Ratio Tester (IBERT)-Kern für Virtex™ 5 FPGA GTX-Transceiver ist ein anpassbarer Kern, der zur Evaluierung und Überwachung des Zustands der GTX-Transceiver verwendet werden kann. Das Design umfasst Mustergeneratoren und Prüftools, die in der FPGA-Logik implementiert sind, sowie den Zugriff auf die Ports und Attribute der Transceiver. Die Kommunikationslogik ist ebenfalls enthalten, damit das Design über JTAG zur Laufzeit zugänglich ist. Der IBERT-Kern ist ein eigenständiges Design, das bei der Generierung den gesamten Implementierungsablauf durchläuft, einschließlich Bitstream-Generierung.
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