von: AMD
Der XDMA/QDMA Simulation IP-Kern ist ein abstraktes, SystemC-basiertes Simulationsmodell für XDMA/QDMA und ermöglicht die Emulation der Kommunikation zwischen Xilinx Runtime (XRT) und Chip.
Der XDMA/QDMA Simulation IP-Kern ist ein abstraktes, SystemC-basiertes Simulationsmodell für XDMA/QDMA und ermöglicht die Emulation der Kommunikation zwischen Xilinx Runtime (XRT) und Chip. Mit diesem IP kann eine Xilinx Runtime Host-Anwendung (über OpenCL™ APIs) mit Kerneln, Speichern und Streaming-Ressourcen kommunizieren, wobei die Kommunikation jedoch auf Transaktionsebene erfolgt und nicht die PCIe®-Ebene modelliert, wie es in echter Hardware der Fall wäre.
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